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Minimizing and Exploiting Leakage in VLSI Design

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Libro In brossura
Libro Minimizing and Exploiting Leakage in VLSI Design Rajesh Garg
Codice Libristo: 09161813
Casa editrice Springer-Verlag New York Inc., novembre 2014
This book presents two techniques to reduce leakage power in digital VLSI ICs. The first reduces lea... Descrizione completa
? points 369 b
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This book presents two techniques to reduce leakage power in digital VLSI ICs. The first reduces leakage through the selective use of high threshold voltage sleep transistors, while the second by applying the optimal Reverse Body Bias voltage.§

Informazioni sul libro

Titolo completo Minimizing and Exploiting Leakage in VLSI Design
Autore Rajesh Garg
Lingua Inglese
Rilegatura Libro - In brossura
Data di pubblicazione 2014
Numero di pagine 214
EAN 9781489985293
ISBN 9781489985293
Codice Libristo 09161813
Casa editrice Springer-Verlag New York Inc.
Peso 379
Dimensioni 155 x 13 x 235

Categorie

Tecnologia, Ingegneria, Agricoltura, processi industriali > Ingegneria elettronica e delle comunicazioni > Ingegneria elettronica > Elettronica: circuiti e componenti
Tecnologia, Ingegneria, Agricoltura, processi industriali > Tecnologia: argomenti di interesse generale > Ingegneria: generale
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